数字集成电路设计
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作者： 李哲英，骆丽编著
出 版 社： 机械工业出版社
出版时间： 2008-1-1字数：版次： 1页数： 335印刷时间： 2008/01/01开本：印次：纸张： 胶版纸I S B N ： 9787111219767包装： 平装内容简介
本书主要介绍了集成电路设计理论与技术的核心，内容包括集成电路理论与技术的发展简史、数字集成电路设计概论、Verilog HDL数字电路描述、数字逻辑模型与仿真分析、数字电路的逻辑设计、数字系统ASIC实现方法、数字集成电路结构设计、CMOS数字集成电路版图设计、数字集成电路设计中的规划、数字集成电路IP核应用技术。
本书紧密地将理论与实际结合起来，注重提高学生分析问题和解决问题的能力，本书可作为高等院校电子信息类专业高年级本科生和研究生的教材和学习参考资料。
目录
前言
第1章 绪论
1.1 集成电路的发展历史
1.2 数字集成电路工艺的进展
1.3 数字集成电路设计中的新课题
1.4 数字集成电路设计技术的学习方法
1.4.1 掌握设计概念
1.4.2 掌握分析技术
第2章 数字集成电路设计概论
2.1 数字集成电路设计的基本内容
2.1.1 数字集成电路的实现方法
2.1.2 数字逻辑系统设计
2.1.3 数字逻辑电路设计
2.1.4 数字电路版图设计
2.2 数字集成电路设计流程
2.2.1 自顶向下的数字集成电路设计流程
2.2.2 系统级设计流程
2.2.3 电路级设计流程
2.2.4 版图级设计流程
2.3 CMOS数字电路
2.3.1 基本CMOS数字电路
2.3.2 CMOS数字电路的主要技术特性
2.4 数字集成电路设计基本技术
2.4.1 数字集成电路分层设计技术
2.4.2 仿真分析
2.5 Verilog HDL基本概念
2.5.1 数字电路系统的模型概念
2.5.2 硬件描述与仿真的基本概念
2.5.3 Verilog HDL的编程原则
本章小结
习题
第3章 Verilog HDL数字电路描述
3.1 数字电路的Verilog HDL描述概念
3.1.1 数字电路的描述方法
3.1.2 Verilog HDL中的时间描述
3.2 Verilog HDL编程规则
3.2.1 Verilog HDL中的数据与变量
3.2.2 Verilog HDL的算子与表达式
3.2.3 Verilog HDL的语句
3.2.4 控制结构
3.2.5 定时控制
3.2.6 编译指令
3.2.7 系统任务
3.3 Verilog HDL中的用户定义原语UDP
3.3.1 用户定义原语的基本概念
3.3.2 UDP中的逻辑结构体
3.3.3 用户定义原语UDP应用
本章小结
习题
第4章 数字逻辑模型与仿真分析
4.1 数字逻辑Verilog HDL模型
4.1.1 开关级模型
4.1.2 门级模型
4.1.3 行为级模型
4.2 数据流分析与数字逻辑模型应用
4.2.1 数据流结构分析
4.2.2 组合逻辑模型应用概念
4.2.3 时序逻辑模型应用概念
4.3 Verilog HDL模型仿真分析
4.3.1 Verilog HDL仿真的基础
4.3.2 组合逻辑的Verilog HDL仿真
4.3.3 时序逻辑的Verilog HDL仿真
本章小结
习题
第5章 数字电路的逻辑设计
5.1 数字逻辑系统设计与验证概念
5.1.1 数字逻辑系统设计
5.1.2 数字逻辑仿真验证与分析
5.2 组合逻辑电路设计与仿真
……
第6章 数字系统ASIC实现方法
第7章 数字集成电路结构设计
第8章 CMOS数字集成电路版图设计
第9章 数字集成电路设计中的规划
第10章 数字集成电路IP核应用技术
附录A ModelSim简明使用手册
附录B Microwind2操作说明
